Alliance Memory SDRAM AS4C1G8D4A-62BIN, 1 GB, Superficie, FBGA 8 bit, 78 pines
- Código RS:
- 665-384
- Referência do fabricante:
- AS4C1G8D4A-62BIN
- Fabricante:
- Alliance Memory
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- 665-384
- Referência do fabricante:
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Especificações
Documentação Técnica
Legislação e Conformidade
Detalhes do produto
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Selecionar tudo | Atributo | Valor |
|---|---|---|
| Marca | Alliance Memory | |
| Tamaño de la memoria | 1GB | |
| Tipo de producto | SDRAM | |
| Organización | 1G x 8 | |
| Ancho del bus de datos | 8bit | |
| Frecuencia del reloj máxima | 1600MHz | |
| Número de bits por palabra | 8 | |
| Tipo de montaje | Superficie | |
| Encapsulado | FBGA | |
| Temperatura de Funcionamiento Mínima | -40°C | |
| Número de pines | 78 | |
| Temperatura de funcionamiento máxima | 95°C | |
| Certificaciones y estándares | JEDEC, RoHS | |
| Longitud | 12mm | |
| Anchura | 7.5 mm | |
| Altura | 1.2mm | |
| Estándar de automoción | No | |
| Tensión de alimentación máxima | 1.26V | |
| Tensión de alimentación mínima | 1.14V | |
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|---|---|---|
Marca Alliance Memory | ||
Tamaño de la memoria 1GB | ||
Tipo de producto SDRAM | ||
Organización 1G x 8 | ||
Ancho del bus de datos 8bit | ||
Frecuencia del reloj máxima 1600MHz | ||
Número de bits por palabra 8 | ||
Tipo de montaje Superficie | ||
Encapsulado FBGA | ||
Temperatura de Funcionamiento Mínima -40°C | ||
Número de pines 78 | ||
Temperatura de funcionamiento máxima 95°C | ||
Certificaciones y estándares JEDEC, RoHS | ||
Longitud 12mm | ||
Anchura 7.5 mm | ||
Altura 1.2mm | ||
Estándar de automoción No | ||
Tensión de alimentación máxima 1.26V | ||
Tensión de alimentación mínima 1.14V | ||
- COO (País de Origem):
- TW
La DRAM DDR4 de 8 Gb de Alliance Memory en un encapsulado FBGA de 78 bolas admite especificaciones de jitter de reloj JEDEC y dispone de una estroboscopia de datos diferencial bidireccional junto con relojes diferenciales. Está organizado internamente en 16 bancos, agrupados en cuatro juegos de cuatro bancos cada uno, con estructuras de puerta de E/S separadas por grupo bancario. El dispositivo utiliza una arquitectura de prefijo de 8 n bits y admite características de ahorro de energía como precarga y desconexión activa, actualización automática, actualización automática, actualización automática de baja potencia (LPASR), interrupción de actualización automática y actualización de granularidad fina, lo que garantiza un funcionamiento eficiente y de alto rendimiento.
Formación VREFDQ interna
Entrenamiento de preámbulo de lectura
Modo de reducción de engranajes de control
Dirigibilidad por DRAM
Control de impedancia de controlador de salida
Terminación de encendido dinámica
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