SDRAM W9751G6NB25I, 512Mbit, 400MHZ, Montaje superficial, VFBGA, 84 pines DDR2
- Código RS:
- 242-0781
- Referência do fabricante:
- W9751G6NB25I
- Fabricante:
- Winbond
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- Código RS:
- 242-0781
- Referência do fabricante:
- W9751G6NB25I
- Fabricante:
- Winbond
Especificações
Documentação Técnica
Legislação e Conformidade
Detalhes do produto
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Selecionar tudo | Atributo | Valor |
|---|---|---|
| Marca | Winbond | |
| Tamaño de la Memoria | 512Mbit | |
| Organización | 32 M x 16 | |
| Clase SDRAM | DDR2 | |
| Transmisión de Datos | 400MHZ | |
| Ancho del Bus de Datos | 16bit | |
| Ancho del Bus de Direcciones | 15bit | |
| Número de Bits de Palabra | 16bit | |
| Tiempo de Acceso Aleatorio Máximo | 0.4ns | |
| Número de Palabras | 32M | |
| Tipo de Montaje | Montaje superficial | |
| Tipo de Encapsulado | VFBGA | |
| Conteo de Pines | 84 | |
| Altura | 0.6mm | |
| Longitud | 12.5mm | |
| Temperatura Máxima de Funcionamiento | +95 °C | |
| Tensión de Alimentación Máxima de Funcionamiento | 1,9 V | |
| Tensión de Alimentación de Funcionamiento Mínima | 1,7 V | |
| Temperatura de Funcionamiento Mínima | -40 °C | |
| Ancho | 8mm | |
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|---|---|---|
Marca Winbond | ||
Tamaño de la Memoria 512Mbit | ||
Organización 32 M x 16 | ||
Clase SDRAM DDR2 | ||
Transmisión de Datos 400MHZ | ||
Ancho del Bus de Datos 16bit | ||
Ancho del Bus de Direcciones 15bit | ||
Número de Bits de Palabra 16bit | ||
Tiempo de Acceso Aleatorio Máximo 0.4ns | ||
Número de Palabras 32M | ||
Tipo de Montaje Montaje superficial | ||
Tipo de Encapsulado VFBGA | ||
Conteo de Pines 84 | ||
Altura 0.6mm | ||
Longitud 12.5mm | ||
Temperatura Máxima de Funcionamiento +95 °C | ||
Tensión de Alimentación Máxima de Funcionamiento 1,9 V | ||
Tensión de Alimentación de Funcionamiento Mínima 1,7 V | ||
Temperatura de Funcionamiento Mínima -40 °C | ||
Ancho 8mm | ||
La SDRAM Winbond es una SDRAM DDR2 de 512 M bits que está organizada como 8.388.608 palabras, 4 bancos, 16 bits. Este dispositivo alcanza velocidades de transferencia de alta velocidad para diversas aplicaciones.
Dos transferencias de datos por ciclo de reloj:
Alineación de borde con datos de lectura y alineación central con datos de escritura
DLL alinea las transiciones DQ y DQS con el reloj
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