Micron SDRAM MT41J128M16JT-125:K, 2 Gb, Montaje superficial, FBGA 16 bit, 96 pines
- Código RS:
- 696-929
- Referência do fabricante:
- MT41J128M16JT-125:K
- Fabricante:
- Micron
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- Código RS:
- 696-929
- Referência do fabricante:
- MT41J128M16JT-125:K
- Fabricante:
- Micron
Especificações
Documentação Técnica
Legislação e Conformidade
Detalhes do produto
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Selecionar tudo | Atributo | Valor |
|---|---|---|
| Marca | Micron | |
| Tipo de producto | SDRAM | |
| Tamaño de la memoria | 2Gb | |
| Ancho del bus de datos | 16bit | |
| Número de bits por palabra | 16 | |
| Frecuencia del reloj máxima | 800MHZ | |
| Tipo de montaje | Montaje superficial | |
| Encapsulado | FBGA | |
| Temperatura de Funcionamiento Mínima | 0°C | |
| Número de pines | 96 | |
| Temperatura de funcionamiento máxima | 95°C | |
| Anchura | 8mm | |
| Longitud | 14mm | |
| Certificaciones y estándares | RoHS | |
| Serie | MT41J | |
| Altura | 1.2mm | |
| Estándar de automoción | No | |
| Tensión de alimentación mínima | 1.425V | |
| Tensión de alimentación máxima | 1.575V | |
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|---|---|---|
Marca Micron | ||
Tipo de producto SDRAM | ||
Tamaño de la memoria 2Gb | ||
Ancho del bus de datos 16bit | ||
Número de bits por palabra 16 | ||
Frecuencia del reloj máxima 800MHZ | ||
Tipo de montaje Montaje superficial | ||
Encapsulado FBGA | ||
Temperatura de Funcionamiento Mínima 0°C | ||
Número de pines 96 | ||
Temperatura de funcionamiento máxima 95°C | ||
Anchura 8mm | ||
Longitud 14mm | ||
Certificaciones y estándares RoHS | ||
Serie MT41J | ||
Altura 1.2mm | ||
Estándar de automoción No | ||
Tensión de alimentación mínima 1.425V | ||
Tensión de alimentación máxima 1.575V | ||
- COO (País de Origem):
- TW
La SDRAM DDR3 de Micron utiliza una arquitectura de doble velocidad de datos para lograr un funcionamiento de alta velocidad. La arquitectura de doble velocidad de datos es una arquitectura prefetch 8n con una interfaz diseñada para transferir dos palabras de datos por ciclo de reloj en los contactos de E/S. Una única operación de lectura o escritura para la SDRAM DDR3 consiste en una única transferencia de datos de 8 n bits de ancho y cuatro ciclos de reloj en el núcleo de DRAM interno y ocho transferencias de datos de n bits de un ciclo de medio reloj correspondientes en los contactos de E/S.
Temperatura de refrescamiento automático
Actualización automática
Registro multiusos
Conforme a RoHS