Intelligent Memory AEC-Q100 SDRAM IM1216SDBABG-6I, 128 MB, Superficie, FBGA 16 bit, 54 pines
- Código RS:
- 588-653
- Referência do fabricante:
- IM1216SDBABG-6I
- Fabricante:
- Intelligent Memory
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- Código RS:
- 588-653
- Referência do fabricante:
- IM1216SDBABG-6I
- Fabricante:
- Intelligent Memory
Especificações
Documentação Técnica
Legislação e Conformidade
Detalhes do produto
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Selecionar tudo | Atributo | Valor |
|---|---|---|
| Marca | Intelligent Memory | |
| Tipo de producto | SDRAM | |
| Tamaño de la memoria | 128MB | |
| Organización | 8M x 16 | |
| Ancho del bus de datos | 16bit | |
| Frecuencia del reloj máxima | 200MHz | |
| Número de bits por palabra | 16 | |
| Tiempo de acceso aleatorio máximo | 5ns | |
| Número de palabras | 8K | |
| Tipo de montaje | Superficie | |
| Encapsulado | FBGA | |
| Número de pines | 54 | |
| Temperatura de Funcionamiento Mínima | -40°C | |
| Temperatura de funcionamiento máxima | 85°C | |
| Anchura | 8 mm | |
| Certificaciones y estándares | AEC-Q100, RoHS | |
| Estándar de automoción | AEC-Q100 | |
| Tensión de alimentación máxima | 3.6V | |
| Tensión de alimentación mínima | 3V | |
| Corriente de suministro | 65mA | |
| Selecionar tudo | ||
|---|---|---|
Marca Intelligent Memory | ||
Tipo de producto SDRAM | ||
Tamaño de la memoria 128MB | ||
Organización 8M x 16 | ||
Ancho del bus de datos 16bit | ||
Frecuencia del reloj máxima 200MHz | ||
Número de bits por palabra 16 | ||
Tiempo de acceso aleatorio máximo 5ns | ||
Número de palabras 8K | ||
Tipo de montaje Superficie | ||
Encapsulado FBGA | ||
Número de pines 54 | ||
Temperatura de Funcionamiento Mínima -40°C | ||
Temperatura de funcionamiento máxima 85°C | ||
Anchura 8 mm | ||
Certificaciones y estándares AEC-Q100, RoHS | ||
Estándar de automoción AEC-Q100 | ||
Tensión de alimentación máxima 3.6V | ||
Tensión de alimentación mínima 3V | ||
Corriente de suministro 65mA | ||
- COO (País de Origem):
- TW
La DRAM síncrona de cuatro bancos organizada como 4 bancos x 2Mbit x 16 consigue tasas de transferencia de datos de alta velocidad de hasta 200 MHz, empleando una arquitectura de chip que preconfigura múltiples bits y luego sincroniza los datos de salida con un reloj del sistema.
Lectura múltiple en ráfaga con una sola operación de escritura
Mando de precarga automático y controlado
Modo de apagado
Actualización automática y autorrenovación
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