STMicroelectronics Microprocesador STM32MP233DAJ3 STM32MP23xA/D ARM Cortex A35, ARM Cortex M33 16 bit ARM V8-M, 64 bits,
- Código RS:
- 482-989
- Referência do fabricante:
- STM32MP233DAJ3
- Fabricante:
- STMicroelectronics
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Especificações
Documentação Técnica
Legislação e Conformidade
Detalhes do produto
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Selecionar tudo | Atributo | Valor |
|---|---|---|
| Marca | STMicroelectronics | |
| Tipo de producto | Microprocesador | |
| Serie | STM32MP23xA/D | |
| Núcleo del dispositivo | ARM Cortex A35, ARM Cortex M33 | |
| Ancho del bus de datos | 16bit | |
| Arquitectura del juego de instrucciones | ARM V8-M, 64 bits, ARM Cortex | |
| Frecuencia del reloj máxima | 1.5GHz | |
| Tipo de interfaz | USB 2.0, UART, SDM, USART, SPI, CAN, I3C, CSI, DDR4, LPDDR4, FMC, Paralelo, I2C, NAND, DDR3L, DSI, LVDS, Ethernet, MIPI | |
| Tensión de alimentación mínima | 1.71V | |
| Encapsulado | TFBGA361 | |
| Número de pines | 361 | |
| Tensión de alimentación máxima | 3.6V | |
| Certificaciones y estándares | JEDEC, ECOPACK2 | |
| Número de núcleos | 2 | |
| Estándar de automoción | No | |
| Selecionar tudo | ||
|---|---|---|
Marca STMicroelectronics | ||
Tipo de producto Microprocesador | ||
Serie STM32MP23xA/D | ||
Núcleo del dispositivo ARM Cortex A35, ARM Cortex M33 | ||
Ancho del bus de datos 16bit | ||
Arquitectura del juego de instrucciones ARM V8-M, 64 bits, ARM Cortex | ||
Frecuencia del reloj máxima 1.5GHz | ||
Tipo de interfaz USB 2.0, UART, SDM, USART, SPI, CAN, I3C, CSI, DDR4, LPDDR4, FMC, Paralelo, I2C, NAND, DDR3L, DSI, LVDS, Ethernet, MIPI | ||
Tensión de alimentación mínima 1.71V | ||
Encapsulado TFBGA361 | ||
Número de pines 361 | ||
Tensión de alimentación máxima 3.6V | ||
Certificaciones y estándares JEDEC, ECOPACK2 | ||
Número de núcleos 2 | ||
Estándar de automoción No | ||
- COO (País de Origem):
- TW
Los dispositivos MPU con doble Arm Cortex-A35 de STMicroelectronics se basan en el núcleo RISC de 64 bits Arm Cortex-A35 de uno o dos núcleos de alto rendimiento que funciona a una frecuencia de hasta 1,5 GHz. El procesador Cortex-A35 incluye una caché de instrucciones L1 de 32 Kb para cada CPU, una caché de datos L1 de 32 Kb para cada CPU y una caché L2 de 512 Kb. El procesador Cortex-A35 utiliza un pipeline de orden interno de 8 etapas altamente eficiente que se ha optimizado ampliamente para ofrecer todas las funciones de Armv8-A al tiempo que se maximiza la eficiencia energética y de área.
Sensores de temperatura interna
Bajo consumo
Gestión del reloj
Interfaz digital paralela de hasta 16 bits de entrada o salida
Dos interfaces de memoria Octo-SPI
Retención de memoria DDR en modo Standby
Controles para chip PMIC complementario
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