FPGA iCE40HX1K-VQ100, iCE40 HX 1280 celdas, 64kbit, 160 bloques, 100 pines VQFP
- Código RS:
- 772-0045P
- Referência do fabricante:
- iCE40HX1K-VQ100
- Fabricante:
- Lattice Semiconductor
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Unidad(es) | Por unidade |
|---|---|
| 10 - 49 | 6,28 € |
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| 100 - 199 | 5,96 € |
| 200 + | 5,81 € |
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- Código RS:
- 772-0045P
- Referência do fabricante:
- iCE40HX1K-VQ100
- Fabricante:
- Lattice Semiconductor
Especificações
Documentação Técnica
Legislação e Conformidade
Detalhes do produto
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Selecionar tudo | Atributo | Valor |
|---|---|---|
| Marca | Lattice Semiconductor | |
| Nombre de la Familia | iCE40 HX | |
| Número de Células Lógicas | 1280 | |
| Número de Unidades Lógicas | 160 | |
| Número de Registros | 1280 | |
| Tipo de Montaje | Montaje superficial | |
| Tipo de Encapsulado | VQFP | |
| Conteo de Pines | 100 | |
| Número de Bits RAM | 64kbit | |
| Dimensiones | 14 x 14 x 1.05mm | |
| Altura | 1.05mm | |
| Longitud | 14mm | |
| Temperatura de Funcionamiento Mínima | -40 °C | |
| Ancho | 14mm | |
| Tensión de Alimentación de Funcionamiento Mínima | 1.14 V | |
| Tensión de Alimentación Máxima de Funcionamiento | 1.26 V | |
| Temperatura Máxima de Funcionamiento | +85 °C | |
| Selecionar tudo | ||
|---|---|---|
Marca Lattice Semiconductor | ||
Nombre de la Familia iCE40 HX | ||
Número de Células Lógicas 1280 | ||
Número de Unidades Lógicas 160 | ||
Número de Registros 1280 | ||
Tipo de Montaje Montaje superficial | ||
Tipo de Encapsulado VQFP | ||
Conteo de Pines 100 | ||
Número de Bits RAM 64kbit | ||
Dimensiones 14 x 14 x 1.05mm | ||
Altura 1.05mm | ||
Longitud 14mm | ||
Temperatura de Funcionamiento Mínima -40 °C | ||
Ancho 14mm | ||
Tensión de Alimentación de Funcionamiento Mínima 1.14 V | ||
Tensión de Alimentación Máxima de Funcionamiento 1.26 V | ||
Temperatura Máxima de Funcionamiento +85 °C | ||
Matrices De Puerta Programables En Campo Lattice Semiconductor
Un FPGA es un dispositivo semiconductor compuesto de una matriz de bloques lógicos configurables (CLB) conectados mediante interconexiones programables. El usuario determina estas interconexiones mediante programación SRAM. Un CLB puede ser simple (puertas Y, O, etc) o complejo (un bloque de RAM). FPGA permite realizar cambios en un diseño incluso después de haber soldado el dispositivo en un PCB.