Referência do fabricante

Nexperia Y: Puerta Lógica 74LVC2G08DC,125 LVC Terminación Única 2 32 mA VSSOP 8 pines 2

Código RS:: 816-8808
Referência do fabricante:: 74LVC2G08DC,125
Fabricante:: Nexperia

Nexperia Y: Puerta Lógica 74LVC2G08DC,125 LVC Terminación Única 2 32 mA VSSOP 8 pines 2

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Código RS:: 816-8808
Referência do fabricante:: 74LVC2G08DC,125
Fabricante:: Nexperia

Especificações

Documentação Técnica

Legislação e Conformidade

Detalhes do produto

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Selecionar tudo	Atributo	Valor
	Marca	Nexperia
	Función lógica	Y
	Tipo de producto	Puerta Lógica
	Tipo de montaje	Superficie
	Número de elementos	2
	Número de entradas por puerta	2
	Entrada Schmitt Trigger	No
	Encapsulado	VSSOP
	Número de pines	8
	Familia lógica	LVC
	Tipo de entrada	TTL
	Temperatura de Funcionamiento Mínima	-40°C
	Tiempo de retardo de propagación máximo CL	4.8ns
	Corriente máxima de salida de nivel alto	-32mA
	Temperatura de funcionamiento máxima	125°C
	Altura	0.85mm
	Certificaciones y estándares	No
	Serie	74LV
	Tensión de alimentación máxima	5.5V
	Tensión de alimentación mínima	1.65V
	Longitud	2.4mm
	Corriente máxima de salida de nivel bajo	32mA
	Tipo de salida	Terminación Única
	Estándar de automoción	No

	Selecionar tudo
	Marca Nexperia
	Función lógica Y
	Tipo de producto Puerta Lógica
	Tipo de montaje Superficie
	Número de elementos 2
	Número de entradas por puerta 2
	Entrada Schmitt Trigger No
	Encapsulado VSSOP
	Número de pines 8
	Familia lógica LVC
	Tipo de entrada TTL
	Temperatura de Funcionamiento Mínima -40°C
	Tiempo de retardo de propagación máximo CL 4.8ns
	Corriente máxima de salida de nivel alto -32mA
	Temperatura de funcionamiento máxima 125°C
	Altura 0.85mm
	Certificaciones y estándares No
	Serie 74LV
	Tensión de alimentación máxima 5.5V
	Tensión de alimentación mínima 1.65V
	Longitud 2.4mm
	Corriente máxima de salida de nivel bajo 32mA
	Tipo de salida Terminación Única
	Estándar de automoción No

74LVC Family Logic Gates

Lógica CMOS de tensión baja

Encapsulado de puerta única

Tensión de funcionamiento: 1,65 a 5,5 V

Compatibilidad: entrada LVTTL/TTL, salida LVCMOS

Familia 74LVC

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