onsemi AEC-Q100 NI: Puerta Lógica TTL 6 2.4 mA SOIC 16 pines
- Código RS:
- 186-7279
- Referência do fabricante:
- MC14572UBDG
- Fabricante:
- onsemi
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| 48 - 1152 | 0,41 € | 19,68 € |
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| 2400 - 4752 | 0,259 € | 12,43 € |
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- Código RS:
- 186-7279
- Referência do fabricante:
- MC14572UBDG
- Fabricante:
- onsemi
Especificações
Documentação Técnica
Legislação e Conformidade
Detalhes do produto
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Selecionar tudo | Atributo | Valor |
|---|---|---|
| Marca | onsemi | |
| Tipo de producto | Puerta Lógica | |
| Función lógica | NI | |
| Tipo de montaje | Superficie | |
| Número de elementos | 6 | |
| Entrada Schmitt Trigger | No | |
| Encapsulado | SOIC | |
| Número de pines | 16 | |
| Tipo de entrada | CMOS | |
| Corriente máxima de salida de nivel alto | -1.1mA | |
| Tiempo de retardo de propagación máximo CL | 80ns | |
| Temperatura de Funcionamiento Mínima | -55°C | |
| Temperatura de funcionamiento máxima | 125°C | |
| Longitud | 10mm | |
| Tensión de alimentación máxima | 18V dc | |
| Altura | 1.5mm | |
| Tensión de alimentación mínima | 3V dc | |
| Certificaciones y estándares | No | |
| Corriente máxima de salida de nivel bajo | 2.4mA | |
| Estándar de automoción | AEC-Q100 | |
| Tipo de salida | TTL | |
| Selecionar tudo | ||
|---|---|---|
Marca onsemi | ||
Tipo de producto Puerta Lógica | ||
Función lógica NI | ||
Tipo de montaje Superficie | ||
Número de elementos 6 | ||
Entrada Schmitt Trigger No | ||
Encapsulado SOIC | ||
Número de pines 16 | ||
Tipo de entrada CMOS | ||
Corriente máxima de salida de nivel alto -1.1mA | ||
Tiempo de retardo de propagación máximo CL 80ns | ||
Temperatura de Funcionamiento Mínima -55°C | ||
Temperatura de funcionamiento máxima 125°C | ||
Longitud 10mm | ||
Tensión de alimentación máxima 18V dc | ||
Altura 1.5mm | ||
Tensión de alimentación mínima 3V dc | ||
Certificaciones y estándares No | ||
Corriente máxima de salida de nivel bajo 2.4mA | ||
Estándar de automoción AEC-Q100 | ||
Tipo de salida TTL | ||
The MC14572UB hex functional gate is constructed with MOS P-channel and N-channel enhancement mode devices in a single monolithic structure. These complementary MOS logic gates find primary use where low power dissipation and/or high noise immunity is desired. The chip contains four inverters, one NOR gate and one NAND gate.
Diode Protection on All Inputs
Single Supply Operation
Supply Voltage Range = 3.0 Vdc to 18 Vdc
NOR Input Pin Adjacent to VSS Pin to Simplify Use As An Inverter
NAND Input Pin Adjacent to VDD Pin to Simplify Use As An Inverter
NOR Output Pin Adjacent to Inverter Input Pin For OR Application
NAND Output Pin Adjacent to Inverter Input Pin For AND Application
Capable of Driving Two Low-power TTL Loads or One Low-Power Schottky TTL Load over the Rated Temperature Range
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