Microchip Microprocesador AT91SAM9CN11-CU AT91SAM9CN11 ARM926EJ-S 32 bit ARM 400 MHZ BGA 217 pines
- Código RS:
- 775-435
- Referência do fabricante:
- AT91SAM9CN11-CU
- Fabricante:
- Microchip
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- Código RS:
- 775-435
- Referência do fabricante:
- AT91SAM9CN11-CU
- Fabricante:
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Especificações
Documentação Técnica
Legislação e Conformidade
Detalhes do produto
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Selecionar tudo | Atributo | Valor |
|---|---|---|
| Marca | Microchip | |
| Serie | AT91SAM9CN11 | |
| Tipo de producto | Microprocesador | |
| Núcleo del dispositivo | ARM926EJ-S | |
| Ancho del bus de datos | 32bit | |
| Arquitectura del juego de instrucciones | ARM | |
| Frecuencia del reloj máxima | 400MHZ | |
| Tipo de interfaz | NAND | |
| Tipo de montaje | Superficie | |
| Tensión de alimentación mínima | 0.9V | |
| Encapsulado | BGA | |
| Número de pines | 217 | |
| Tensión de alimentación máxima | 1.1V | |
| Temperatura de Funcionamiento Mínima | -40°C | |
| Temperatura de funcionamiento máxima | 85°C | |
| Número de núcleos | 1 | |
| Estándar de automoción | No | |
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|---|---|---|
Marca Microchip | ||
Serie AT91SAM9CN11 | ||
Tipo de producto Microprocesador | ||
Núcleo del dispositivo ARM926EJ-S | ||
Ancho del bus de datos 32bit | ||
Arquitectura del juego de instrucciones ARM | ||
Frecuencia del reloj máxima 400MHZ | ||
Tipo de interfaz NAND | ||
Tipo de montaje Superficie | ||
Tensión de alimentación mínima 0.9V | ||
Encapsulado BGA | ||
Número de pines 217 | ||
Tensión de alimentación máxima 1.1V | ||
Temperatura de Funcionamiento Mínima -40°C | ||
Temperatura de funcionamiento máxima 85°C | ||
Número de núcleos 1 | ||
Estándar de automoción No | ||
- COO (País de Origem):
- CN
El microprocesador de Microchip ofrece un rendimiento robusto adaptado a aplicaciones multitasking que requieren una gestión de memoria completa, eficiencia y un consumo de potencia mínimo.
Admite juegos de instrucciones ARM de 32 bits y Thumb de 16 bits para un desarrollo de aplicaciones versátil
Incorpora una unidad de gestión de memoria (MMU) para mejorar la gestión de recursos
Dispone de una arquitectura Harvard con interfaces de bus de datos e instrucciones separadas para mejorar la eficiencia
Permite la integración de coprocesador externo para aceleración de hardware sin complejidad adicional